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http://hdl.handle.net/11133/1037
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| タイトル: | (p,q)論理を応用した10値全加算器の一構成法 |
| その他のタイトル: | P Q ロンリ オ オウヨウシタ 10チ ゼンカサンキ ノ イチコウセイホウ
Realization of 10 Valued Full Adder utilizing the (p,q)-Logic |
| 著者: | 長谷川, 忠光
羽賀, 隆洋
HASEGAWA, Tadamitsu
HAGA, Takahiro |
| 発行日: | 1998年3月31日火曜日 |
| 出版者: | 愛知工業大学 |
| 抄録: | In this paper, it is proposed that the p-valued full adder is realized by the (p, q)-adic・min・max scheme which is rather low cost. It is also shown, However, that the circuit cost varies largely with the numbering of the vertices of full adder whitch is p-valued logical function. |
| URI: | http://hdl.handle.net/11133/1037 |
| 出現コレクション: | 33号
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